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吴鹏

作品数:2 被引量:9H指数:2
供职机构:浙江大学电气工程学院超大规模集成电路设计研究所更多>>
相关领域:电子电信更多>>

文献类型

  • 2篇中文期刊文章

领域

  • 2篇电子电信

主题

  • 2篇电路
  • 2篇电路设计
  • 2篇集成电路
  • 1篇低压差
  • 1篇低压差线性稳...
  • 1篇噪声
  • 1篇闪烁噪声
  • 1篇输出噪声
  • 1篇热噪声
  • 1篇稳压
  • 1篇稳压器
  • 1篇线性稳压器
  • 1篇模拟集成电路
  • 1篇静电保护
  • 1篇静电放电
  • 1篇静电放电保护
  • 1篇集成电路设计
  • 1篇CMOS模拟...
  • 1篇LDO

机构

  • 2篇浙江大学
  • 1篇桂林电子科技...

作者

  • 2篇吴鹏
  • 2篇何乐年
  • 1篇唐宁
  • 1篇朱勤为
  • 1篇陈曦

传媒

  • 1篇电子器件
  • 1篇江南大学学报...

年份

  • 1篇2009
  • 1篇2005
2 条 记 录,以下是 1-2
排序方式:
高速CMOS模拟集成电路中的静电保护电路设计被引量:3
2005年
分析了静电放电(ESD)保护的基本原理,指出了传统的用于模拟电路的 ESD保护电路在高速电路应用中的局限性.提出了在端口的栅极接地NMOS管和栅极接电源 PMOS管的基础上,加上电源与地之间的高速静电泻放回路(片上保护)的新电路结构.仿真结果表明,该电路满足USB2.0高速接口电路的ESD保护要求.试验测试结果表明该 ESD保护电路在人体模式下的击穿电压在正负2 500 V以上,具有实际的应用意义.
吴鹏何乐年陈曦
关键词:静电放电保护
LDO低输出噪声的分析与优化设计被引量:6
2009年
为了降低一款LDO芯片的输出噪声,对LDO的噪声特性进行分析,根据其噪声特点,提出了三种降低LDO输出噪声的方法,分别是改变LDO的电路结构,对带隙基准进行滤波,设计低噪声带隙基准。在综合考虑芯片的面积和功耗后,采用第三种方法对一款LDO芯片输出噪声进行优化,设计了一个低噪声带隙基准(Bandgap reference),在TSMC0.35μm工艺下仿真表明,10Hz到100kHz之间的集成输出噪声(Integrated output noise)从原来的808μV,降低到280μV。采用低噪声带隙基准可以有效的降低LDO芯片的输出噪声。
朱勤为唐宁吴鹏何乐年
关键词:集成电路设计低压差线性稳压器热噪声闪烁噪声
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